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HES は HDL シミュレータ(Riviera-PRO, Active-HDL またはサードパーティシ ミュレータ) 、アクセラレーションボードそしてパテントを取得したソフ トウェアの統合によって RTL, ゲートレベルシミュレーションを高速に実 行する為のハードウェアアクセラレータです。


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お知らせ:

  この度の「東北関東大震災」により被災されました皆様、関係者の皆様に心より
 お見舞い申し上げます。皆様の安全と一日も早い被災地の復興を心から祈念いたします。


1/23/2012 - アルデック、セーフティクリティカルな設計へのドキュメンテーションをALINT 2012.01に追加

Aldec, Inc., (以下アルデック)は本日、HDLベースのFPGA/ASIC設計のためのデザイン・ルール・チェッキングのアプリケーション、ALINT 2012.01をリリースしたことを発表します。more 

 

 

1/9/2012 - アルデックとSynthWorksは、OS-VVMによりランダム化およびファンクショナルカバレッジ機能をVHDL設計者に提供

Aldec, Inc., (以下アルデック)は、SynthWorks Design Inc.,(以下SynthWorks)と連携して、VHDLデザインコミニュティを引き続きサポートするというパートナーシップ・コミットメントを強調しつつ、Open Source - VHDL Verification Methodology (OS-VVM) が利用可能であることを本日発表します。more 

 

11/15/2011 - アルデック、ハードウェア・エミュレーション実行時に100%の可視性を提供するHVDテクノロジを発表

Aldec, Inc (以下アルデック)は、Riviera-PROシミュレータとHES-DVMエミュレーション・プラットフォームに大幅な機能強化が行われたことを発表しますmore 

 

11/14/2011 - アルデック、VMMとOVMの相互運用を可能にするUVM1.1の完全なサポートを提供

Aldec, Inc (以下アルデック)は、UVM(Universal Verification Methodology), Version 1.1を完全にサポートするRiviera-PRO 2011.10をリリースしたことを本日発表します。more 

 

 

デザイン品質、再利用性向上ワークショップ

2012年2月3日(金)13:30-17:00

 

シミュレーション高速化ワークショップ

2012年2月22日(水)13:30-17:00

 

アサーション・ワークショップ(PSL編)

 

アサーション・ワークショップ(SVA編)

2012年2月10日(金)13:30-17:00

 

Active-HDL 導入ワークショップ

2012年2月15日(水)13:30-17:00

 

MATLAB/Simulink協調検証ワークショップ

2012年2月24日(金)13:30-17:00

 

東京FPGAカンファレンス

2012年1月27日(金)

 

VHDLによるRTL設計スタイルガイドセミナー

2012年3月2日(金)13:30-17:30

 



Lattice Semiconductor 社は、高性能プログラマブル・ロジック・デバイス(PLD)とその開発ソフトウェアの開発、設計、販売を行っています。通信、コンピュータ、産業用機器、および軍需産業で多く使用されています。Aldec のシミュレータとデザインエントリツールは Lattice Semiconductor 社の開発ソフトウェアとシームレスに統合されています。

 
Testimonials

「Active-HDL は非常にユーザーフレンドリーなツールで、誰もが簡単にそれを使うことができます。 シミュレーションパフォーマンスは非常に速く、波形をカット&ペーストできるのでドキュメント作成に非常に役立っています。」 more

 
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